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PCIe-FRM10 Users Manual (Rev 1.4)

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[그림 2-7. Camera Control LVDS Digital 출력 회로]

아래 그림은 Camera-link 케이블을 통하여 입력되는 시리얼 입력 신호를 PCIe-FRM10 보드에서

일반 입력으로 사용하는 회로를 보여주고 있다.

[그림 2-8. Serial Communication LVDS Digital 출력 회로]

PCIe-FRM10은 다음의 비트 정렬(bit allocation)을 포함한 Base Configuration을 지원한다.

 1 Pixel (or Tap) at 14 Bits

1 2 ... 7 8 9 10 11 12 13 14 15 16 17 ... 34 35

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